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高速异步时分交换电路主要适应于SDH系统中集成电路芯片内部交换网络结构设计范围,属于SDH宽带通信技术领域。本发明通过对存储器读写访问的特殊结构处理将时分交换电路中的异步数据fifo缓冲器和交换数据存储器两块功能独立的存储器合并为一块且能够完成两块存储器的功能,从而简化电路设计复杂度,减小芯片使用面积,降低系统电路功耗和提高系统工作的可靠性。该发明可用于解决多路高速SDH时分交换电路结构设计。
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